| 1 | /* SPDX-License-Identifier: MIT */ |
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| 2 | /* |
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| 4 | */ |
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| 6 | #ifndef _XE_MMIO_H_ |
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| 7 | #define _XE_MMIO_H_ |
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| 9 | #include "xe_gt_types.h" |
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| 11 | struct xe_device; |
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| 12 | struct xe_reg; |
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| 14 | int xe_mmio_probe_early(struct xe_device *xe); |
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| 15 | int xe_mmio_probe_tiles(struct xe_device *xe); |
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| 17 | void xe_mmio_init(struct xe_mmio *mmio, struct xe_tile *tile, void __iomem *ptr, u32 size); |
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| 19 | u8 xe_mmio_read8(struct xe_mmio *mmio, struct xe_reg reg); |
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| 20 | u16 xe_mmio_read16(struct xe_mmio *mmio, struct xe_reg reg); |
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| 21 | void xe_mmio_write32(struct xe_mmio *mmio, struct xe_reg reg, u32 val); |
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| 22 | u32 xe_mmio_read32(struct xe_mmio *mmio, struct xe_reg reg); |
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| 23 | u32 xe_mmio_rmw32(struct xe_mmio *mmio, struct xe_reg reg, u32 clr, u32 set); |
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| 24 | int xe_mmio_write32_and_verify(struct xe_mmio *mmio, struct xe_reg reg, u32 val, u32 mask, u32 eval); |
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| 25 | bool xe_mmio_in_range(const struct xe_mmio *mmio, const struct xe_mmio_range *range, struct xe_reg reg); |
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| 26 | |
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| 27 | u64 xe_mmio_read64_2x32(struct xe_mmio *mmio, struct xe_reg reg); |
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| 28 | int xe_mmio_wait32(struct xe_mmio *mmio, struct xe_reg reg, u32 mask, u32 val, |
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| 29 | u32 timeout_us, u32 *out_val, bool atomic); |
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| 30 | int xe_mmio_wait32_not(struct xe_mmio *mmio, struct xe_reg reg, u32 mask, |
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| 31 | u32 val, u32 timeout_us, u32 *out_val, bool atomic); |
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| 32 | |
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| 33 | static inline u32 xe_mmio_adjusted_addr(const struct xe_mmio *mmio, u32 addr) |
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| 34 | { |
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| 35 | if (addr < mmio->adj_limit) |
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| 36 | addr += mmio->adj_offset; |
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| 37 | return addr; |
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| 38 | } |
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| 39 | |
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| 40 | static inline struct xe_mmio *xe_root_tile_mmio(struct xe_device *xe) |
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| 41 | { |
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| 42 | return &xe->tiles[0].mmio; |
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| 43 | } |
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| 44 | |
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| 45 | #ifdef CONFIG_PCI_IOV |
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| 46 | void xe_mmio_init_vf_view(struct xe_mmio *mmio, const struct xe_mmio *base, unsigned int vfid); |
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| 47 | #endif |
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| 48 | |
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| 49 | #endif |
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| 50 | |
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